
DDR5 UDIMM 至 Clock Buffered DIMMs (CUDIMM) 的演進
DDR5是新一代的 PC DDR 記憶體,廣泛應用於數據中心、筆記型電腦、個人電腦、自駕系統、伺服器、雲端運算和遊戲等領域,隨著記憶體帶寬和密度的進步,現在越來越多地被用於人工智慧應用。DDR5…

Allegro 如何設定零件距離(DFA)檢查 (1) - 如何對 Library 自動生成 DFA_Bound
在Constraint Manager中有內建了零件距離的檢查功能,這個功能的特色在於當您在放置(移動)零件時,如果與其他零件距離過近時,它會主動阻擋您並且會出現”泡泡”與DRC標示,讓您知道目前的距離過已經近了!!如下圖所示
當您移開到符合距離規格時,”泡泡”與DRC標示便會自動消失!!這樣做可以確保在置件階段便可以一次做對!!省掉重複檢查修正的後續過程!!並且可以取代以前”用眼睛檢查”造成的不確定性!
由於這個檢查是以…

Allegro 如何重用之前的視窗環境設定
相信每個Allegro Layout的user都會自有一套屬於個人習慣的視窗環境設定。但是可能有機會遇到需要臨時更換電腦工作或是視窗環境遭人更動了…等情境,所以最好早做準備,將您所習慣的視窗環境設定留存下來,以便後續隨時復原或是快速設定新環境!!
接下來說明操作過程:
Step…

Allegro Rout Keepout允許特定Nets在區域中走線且不出現DRC的設定過程
我們經常會在Board中設置Rout Keepout 區,這樣可以確保不會有任何導體經過這個區域,但是有時我們會有要走線進入該區域與Pin或…

Allegro 如何將零歐姆電阻放到內層
我們經常會在Board的外層放置SMD零歐姆電阻,但是如果為了增加走線空間而要把零歐姆電阻改放到內層,這時候要怎麼做呢?…

如何用極座標方式在大孔周圍平均設定8個小孔
版本:v16.6 以上
這份技術文件主要分享下列兩個重點:
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Allegro 如何針對已走對線變更線寬與間距
版本:v16.6 以上
我們在Layout時,常常遇到對線(Diff.…

Allegro 如何快速將同類型的DRCs設為忽略狀態(Waived)
版本:v17.2 以上
實務上我們有時候會因為一些特殊的Layout狀況,而造成出現固定類型的DRC,因為我們知道哪些DRC是可以”忽略”(Waived)的,然而該類型的DRC的數量有可能是很多的。這時候要如何做才可以快速又正確的”忽略”那些呢DRC?,接下來我們用一個簡單的範例來說明這個過程。
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我們由…

Allegro 設定了 Signal Model 但沒有生成 Xnet 的解決方法
版本:v17.2
通常我們使用Allegro對被動零件設定了Signal…

OrCAD Allegro Cross Probing - 零件與滑鼠屬標自動連結
版本:v17.4
我們常會利用OrCAD與Allegro 相互Cross…