CadenceTECHTALK: Design, Simulate, and Validate Your Circuit with PSpice
24 April 2024 Alok Tripathi, Senior Product Engineering […]
關於 poweruser
這位作者還沒有寫個人簡歷。我們為 poweruser 對 102 篇日誌做的貢獻感到驕傲。
日誌 poweruser
Allegro 如何快速將同類型的DRCs設為忽略狀態(Waived)
2024-04-29 在： Allegro, 技術資訊, DFM/DFA/DRC /通過： poweruser版本:v17.2 以上 實務上我們有時候會因為一些特殊的Layout狀況，而造成出現固定類型的DRC，因為我們 […]
OrCAD X Capture CIS 23.1 QIR1 新功能
2024-04-26 在： Capture & CIS, OrCAD, 首頁分類, 產品新功能 /通過： poweruserOrCAD X Capture CIS 23.1 QIR1 新功能說明 請由此進入
Allegro X 23.1 QIR1新功能
2024-04-26 在： Allegro, 產品新功能 /通過： poweruserAllegro X 23.1 QIR1新功能說明 請由此進入
Allegro X 23.1 新功能
2024-04-14 在： Allegro /通過： poweruserAllegro X 23.1 新功能說明 請由此進入
OrCAD Capture – 如何修正WARNING(ORCAP-2434)的錯誤訊息
2024-04-09 在： OrCAD, Design, 技術資訊 /通過： poweruser版本:v17.4 這個錯誤訊息會造成無法在OrCAD Capture對該零件使用Show Footprint的 […]
OrCAD Capture如何輸出零件資訊報告
2024-03-19 在： OrCAD, Output, 技術資訊 /通過： poweruserVersion: 17.2以上 電路圖如何輸出零件料號、Symbol Name以及Footprint資訊，請參 […]
Allegro 設定了 Signal Model 但沒有生成 Xnet 的解決方法
2024-03-19 在： Allegro, Routing, 技術資訊 /通過： poweruser版本:v17.2 通常我們使用Allegro對被動零件設定了Signal Model之後，Allegro便會自 […]
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