Topology Workbench-如何判斷ibis Model是否有包含package length
Version: Sigrity2023.1 判斷方法: 其關鍵字為pin RLC，如下圖紅框處，有勾選pac […]
關於 poweruser
這位作者還沒有寫個人簡歷。我們為 poweruser 對 108 篇日誌做的貢獻感到驕傲。
日誌 poweruser
PowerDC如何自定義PCB疊構材質
2024-05-30 在： Sigrity, 技術資訊 /通過： poweruserVersion: Sigrity2021 Step1: 從Library中，選取一個類似的材料，例如: FR- […]
PowerDC如何兩顆零件上架設散熱片
2024-05-24 在： Sigrity, 技術資訊 /通過： poweruserVersion: Sigrity2022 Step1: Select Thermal Components。 […]
Topology Workbench-如何縮短眼圖模擬時間
2024-05-24 在： Sigrity, 技術資訊 /通過： poweruserVersion: Sigrity2023.1 方法1: 將Minimum # of Bits 數量調小至100 […]
Allegro 如何針對已走對線變更線寬與間距
2024-05-22 在： Allegro, Routing, 技術資訊 /通過： poweruser版本:v16.6 以上 我們在Layout時，常常遇到對線(Diff. Pairs)已經拉好了，卻又要改變線寬 […]
Allegro X APD 23.1 QIR1 新功能
2024-05-07 在： 首頁分類, 產品新功能, APD+ /通過： poweruserAllegro X APD 23.1 QIR1 新功能說明 請由此進入
CadenceTECHTALK: Design, Simulate, and Validate Your Circuit with PSpice
2024-05-07 在： 最新消息 /通過： poweruser24 April 2024 Alok Tripathi, Senior Product Engineering […]
Allegro 如何快速將同類型的DRCs設為忽略狀態(Waived)
2024-04-29 在： Allegro, DFM/DFA/DRC, 技術資訊 /通過： poweruser版本:v17.2 以上 實務上我們有時候會因為一些特殊的Layout狀況，而造成出現固定類型的DRC，因為我們 […]
OrCAD X Capture CIS 23.1 QIR1 新功能
2024-04-26 在： OrCAD, Capture & CIS, 首頁分類, 產品新功能 /通過： poweruserOrCAD X Capture CIS 23.1 QIR1 新功能說明 請由此進入
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